產(chǎn)品詳情

Output type LVPECL Output frequency (MHz) 155.52 Stability (ppm) 25 Supply voltage (V) 3.3 Operating temperature range (°C) -40 to 85 Jitter (ps) 0.15
Output type LVPECL Output frequency (MHz) 155.52 Stability (ppm) 25 Supply voltage (V) 3.3 Operating temperature range (°C) -40 to 85 Jitter (ps) 0.15
QFM (SIA) 6 35 mm2 7 x 5
  • 超低噪聲、高性能
    • 抖動：Fout > 100MHz 時的典型值為 90fs RMS
    • PSRR：–70dBc，強大的電源抗噪性
  • 支持的輸出格式
    • LVPECL 高達 1 GHz
    • LVDS 高達 900 MHz
    • HSTL 高達 400 MHz
  • 總頻率容差：±50ppm(LMK61X2) 和 ± 25ppm (LMK61X0)
  • 3.3V 工作電壓
  • 工業(yè)溫度范圍（-40oC 至 +85oC）
  • 7mm × 5mm 6 引腳封裝，與行業(yè)標(biāo)準(zhǔn) 7050 XO 封裝引腳兼容
  • 超低噪聲、高性能
    • 抖動：Fout > 100MHz 時的典型值為 90fs RMS
    • PSRR：–70dBc，強大的電源抗噪性
  • 支持的輸出格式
    • LVPECL 高達 1 GHz
    • LVDS 高達 900 MHz
    • HSTL 高達 400 MHz
  • 總頻率容差：±50ppm(LMK61X2) 和 ± 25ppm (LMK61X0)
  • 3.3V 工作電壓
  • 工業(yè)溫度范圍（-40oC 至 +85oC）
  • 7mm × 5mm 6 引腳封裝，與行業(yè)標(biāo)準(zhǔn) 7050 XO 封裝引腳兼容

LMK61XX 是一款超低抖動振蕩器，可生成常用的基準(zhǔn)時鐘。該器件在出廠前進行了預(yù)編程，支持任何基準(zhǔn)時鐘頻率；支持的輸出格式包括 LVPECL（最高 1GHz）、LVDS（最高 900MHz）和 HCSL（最高 400MHz）。內(nèi)部電源調(diào)節(jié)功能提供出色的電源紋波抑制 (PSRR)，降低了供電網(wǎng)絡(luò)的成本和復(fù)雜性。該器件由單個 3.3V ± 5% 電源供電。

LMK61XX 是一款超低抖動振蕩器，可生成常用的基準(zhǔn)時鐘。該器件在出廠前進行了預(yù)編程，支持任何基準(zhǔn)時鐘頻率；支持的輸出格式包括 LVPECL（最高 1GHz）、LVDS（最高 900MHz）和 HCSL（最高 400MHz）。內(nèi)部電源調(diào)節(jié)功能提供出色的電源紋波抑制 (PSRR)，降低了供電網(wǎng)絡(luò)的成本和復(fù)雜性。該器件由單個 3.3V ± 5% 電源供電。

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技術(shù)文檔

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* 數(shù)據(jù)表 LMK61XX 高性能超低抖動振蕩器 數(shù)據(jù)表 (Rev. D) PDF | HTML 英語版 (Rev.D) PDF | HTML 2018年 2月 6日

設(shè)計與開發(fā)

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評估板

LMK61E2-156M25EVM — LMK61E2-156M25 超低抖動固定頻率振蕩器 EVM

LMK61E2-156M25EVM 評估模塊提供了一個完整平臺來評估德州儀器 (TI) LMK61E2-156M25 超低抖動固定頻率振蕩器的 90fs RMS 抖動性能。

板載電源選項提供了常見應(yīng)用中所需的易用性和配置靈活性。邊緣發(fā)射 SMA 端口可用于訪問 LMK61E2-156M25 的差分時鐘輸出，從而使用市售同軸電纜、適配器或平衡-非平衡變壓器（未附帶）連接到測試設(shè)備或參考板。

用戶指南: PDF
TI.com 上無現(xiàn)貨
設(shè)計工具

CLOCK-TREE-ARCHITECT — 時鐘樹架構(gòu)編程軟件

時鐘樹架構(gòu)是一款時鐘樹綜合工具，可根據(jù)您的系統(tǒng)要求生成時鐘樹解決方案，從而幫助您簡化設(shè)計流程。該工具從龐大的時鐘產(chǎn)品數(shù)據(jù)庫中提取數(shù)據(jù)，然后生成系統(tǒng)級多芯片時鐘解決方案。
立即設(shè)計
設(shè)計工具

PLLATINUMSIM-SW — PLL loop filter, phase noise, lock time, and spur simulation tool

PLLATINUMSIM-SW is a simulation tool that allows users to create detailed designs and simulations of our PLLatinum™ integrated circuits, which include the LMX series of phase-locked loops (PLLs) and synthesizers.

支持的產(chǎn)品和硬件

支持的產(chǎn)品和硬件
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模擬工具

PSPICE-FOR-TI — PSpice? for TI 設(shè)計和仿真工具

PSpice? for TI 可提供幫助評估模擬電路功能的設(shè)計和仿真環(huán)境。此功能齊全的設(shè)計和仿真套件使用 Cadence? 的模擬分析引擎。PSpice for TI 可免費使用，包括業(yè)內(nèi)超大的模型庫之一，涵蓋我們的模擬和電源產(chǎn)品系列以及精選的模擬行為模型。

借助?PSpice for TI 的設(shè)計和仿真環(huán)境及其內(nèi)置的模型庫，您可對復(fù)雜的混合信號設(shè)計進行仿真。創(chuàng)建完整的終端設(shè)備設(shè)計和原型解決方案，然后再進行布局和制造，可縮短產(chǎn)品上市時間并降低開發(fā)成本。?

在?PSpice for TI 設(shè)計和仿真工具中，您可以搜索 TI (...)
發(fā)送申請
封裝 引腳 CAD 符號、封裝和 3D 模型
QFM (SIA) 6 Ultra Librarian

訂購和質(zhì)量

包含信息：
  • RoHS
  • REACH
  • 器件標(biāo)識
  • 引腳鍍層/焊球材料
  • MSL 等級/回流焊峰值溫度
  • MTBF/時基故障估算
  • 材料成分
  • 鑒定摘要
  • 持續(xù)可靠性監(jiān)測
包含信息：
  • 制造廠地點
  • 封裝廠地點

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