PLLATINUMSIM-SW — PLLatinum Sim Tool
PLLATINUMSIM-SW is a simulation tool that allows users to create detailed designs and simulations of our PLLatinum™ integrated circuits, which include the LMX series of phase-locked loops (PLLs) and synthesizers.
LMK1D2106:6mm × 6mm 40 引腳 VQFN (RHA)
LMK1D2108:7mm × 7mm 48 引腳 VQFN (RGZ)
LMK1D210x 時鐘緩沖器將兩個時鐘輸入(IN0 和 IN1)分配給 LMK1D2108 中的共 16 對差分 LVDS 時鐘輸出(OUT0 至 OUT15),以及 LMK1D2106 中的共 12 對時鐘輸出(OUT0 至 OUT11),通過超小延遲實現時鐘分配。每個緩沖器塊由一個輸入和最多 6 個 (LMK1D2106) 或 8 個 (LMK1D2108) LVDS 輸出組成。輸入可以為 LVDS、LVPECL、HCSL、CML 或 LVCMOS。
LMK1D210x 專為驅動 50Ω 傳輸線路而設計。在單端模式下驅動輸入時,對未使用的負輸入引腳施加適當的偏置電壓(請參閱Figure 8-6)。
使用控制引腳 (EN) 可以啟用或禁用輸出組。如果該引腳保持開路,將啟用兩個組輸出。如果控制引腳切換至邏輯“0”,則兩個組輸出均被禁用(靜態邏輯“0”)。如果控制引腳切換至邏輯“1”,則一個組的輸出被禁用,而另一個組的輸出被啟用。該器件還支持失效防護功能。該器件還整合了輸入遲滯,可防止在沒有輸入信號的情況下輸出隨機振蕩。
該器件可在 1.8V、2.5V 或 3.3V 電源環境下工作,額定溫度范圍是 –40°C 至 105°C(環境溫度)。
| 類型 | 標題 | 下載最新的英語版本 | 日期 | |||
|---|---|---|---|---|---|---|
| * | 數據表 | LMK1D210x 低附加抖動 LVDS 緩沖器 數據表 (Rev. A) | PDF | HTML | 英語版 (Rev.A) | PDF | HTML | 2022年 3月 17日 |
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PLLATINUMSIM-SW is a simulation tool that allows users to create detailed designs and simulations of our PLLatinum™ integrated circuits, which include the LMX series of phase-locked loops (PLLs) and synthesizers.
| 封裝 | 引腳 | CAD 符號、封裝和 3D 模型 |
|---|---|---|
| VQFN (RGZ) | 48 | Ultra Librarian |
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PLLatinum Sim User's Guide
PLLatinum Sim software manifest
PLLatinum Sim 1.6.9 includes the ability to manually specify points on a phase noise curve (for VCOs or other devices that do not fit the standard three-point model), and as a result the phase noise estimation for many devices which use a BAW VCO is greatly improved. Also includes a bugfix for cascading noise inputs.