CDCM9102
- 包括鎖相環路 (PLL)、壓控振蕩器 (VCO)、和回路過濾器的集成型低噪聲時鐘生成器
- 2 個低噪聲 100MHz 時鐘(低電壓正射極耦合邏輯 (LVPECL),低壓差分信號 (LVDS),或者低壓 CMOS (LVCOMS) 對)
- 支持高速電流控制邏輯 (HCSL) 信號傳輸電平
(交流耦合) - 典型周期抖動:峰值到峰值 (pk-pk) 21ps
- 典型隨機抖動:510ps RMS
- 由引腳設定的輸出類型
- 支持高速電流控制邏輯 (HCSL) 信號傳輸電平
- 附加單端 25MHz 輸出
- 集成晶振輸入接受
25MHz 晶振 - 輸出使能引腳,可關斷器件和輸出
- 32 引腳 5mm × 5mm 超薄型四方扁平無引線 (VQFN) 封裝
- 靜電放電 (ESD) 保護超過 2000V 人體模型 (HBM) 和 500V 帶電器件模型 (CDM)
- 工業溫度范圍(-40°C 至 85°C)
- 3.3V 電源
應用范圍
- PCI Express
1 代、2 代和 3 代的基準時鐘生成 - 通用計時
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CDCM9102 是一款為諸如 PCI Express的通信標準提供基準時鐘而設計的低抖動時鐘生成器. 該器件最高支持 PCIE 3 代,易于配置和使用。CDCM9102 提供 2 個 100MHz 差分時鐘端口。這些端口支持的輸出類型包括 LVPECL,LVDS,或者一對 LVCMOS 緩沖器。HCSL 信號傳輸由交流耦合網絡提供支持。用戶配置捆綁器件引腳所需的輸出緩沖器類型。此外,提供一個單端 25 MHz 時鐘輸出端口。這一端口的使用包括通用計時、計時以太網物理層 (PHY)、或者為附加的時鐘生成器提供一個基準時鐘。所有生成的時鐘來自一個單一外部 25MHz 晶體。
技術文檔
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查看全部 3 | 類型 | 標題 | 下載最新的英語版本 | 日期 | |||
|---|---|---|---|---|---|---|
| * | 數據表 | CDCM9102 低噪聲雙通道 100MHz 時鐘發生器 數據表 (Rev. A) | PDF | HTML | 英語版 (Rev.A) | PDF | HTML | 2016年 6月 23日 |
| 設計指南 | 適用于 Xilinx FPGA 的模擬器件 解決方案指南 | 2012年 4月 24日 | ||||
| EVM 用戶指南 | CDCM9102EVM Evaluation Module | 2012年 2月 27日 |
設計和開發
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設計工具
CLOCK-TREE-ARCHITECT — 時鐘樹架構編程軟件
時鐘樹架構是一款時鐘樹綜合工具,可根據您的系統要求生成時鐘樹解決方案,從而幫助您簡化設計流程。該工具從龐大的時鐘產品數據庫中提取數據,然后生成系統級多芯片時鐘解決方案。
模擬工具
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參考設計
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PROFINET 可實現高速、確定性通信和企業連接,因此正在成為自動化領域的主要工業以太網協議。但是,PROFIBUS 作為世界上常用的現場總線協議,出于保護過往投資的原因,該協議在未來許多年內仍會占有重要地位并將得到沿用。鑒于流程工廠的混合屬性,該參考設計通過 Sitara? AM57x 處理器的可編程實時單元與工業通信子系統 (PRU-ICSS),為現有現場總線技術向實時以太網網絡的遷移提供核心支持。該設計在 AM572x 上實現 PROFIBUS 主站與 PROFINET IRT 器件功能:協議棧同步運行于 ARM Cortex-A15 核心,而整個 PROFINET 交換機和 (...)
參考設計
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| 封裝 | 引腳 | CAD 符號、封裝和 3D 模型 |
|---|---|---|
| VQFN (RHB) | 32 | Ultra Librarian |
訂購和質量
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