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ZHCUA92E May 2022 – May 2025

4.6.2 以太網 PHY #2： CPSW RGMII/ICSSM

注： TRM 中提供的 PRU 內部引腳多路復用映射是 PRU 原始硬件定義的一部分。但是，由于 IP 和相關固件配置提供的靈活性，這未必是硬性要求。AM65x 的第一個 PRU 實施方案在初始 SoC 集成期間交換了 MII TX 引腳，并在后續 PRU 修訂版中保留了該約定，以實現固件重用。要使用 SDK 固件，請使用 SYSCONFIG 生成的 PRU 引腳映射。

AM263x LaunchPad 采用一個 48 引腳以太網 PHY (DP83869HMRGZT)，該 PHY 連接到 CPSW RGMII 或一個片上可編程實時單元和工業通信子系統 (PRU-ICSS)。RGMII CPSW 端口和 ICSSM 在 AM263x SoC 上通過內部進行引腳多路復用。有關信號內部多路復用的更多信息，請參閱引腳多路復用映射。該 PHY 配置為廣播 1Gb 操作。該 PHY 的以太網數據信號端接至 RJ45 連接器。電路板使用 RJ45 連接器來提供以太網 10/100/1000Mbps 連接，并集成電磁元件和 LED 來提供鏈路和活動指示。

A. 用紅色虛線框標出的串聯終端電阻從 0Ω 更新為 33Ω，以提高 AM263x MCU MDIO 引腳和連接的 PHY 引腳之間的信號完整性。修改由 LaunchPad 頂部靠近 PORz 按鈕的“M1”標簽表示。

圖 4-9 以太網 PHY #2

該以太網 PHY 需要三個單獨的電源。VDDIO 是系統生成的 3.3V 電源。以太網 PHY 的 1.1V 和 2.5V 電源有專用的 LDO。

靠近 SoC 的發送時鐘和數據信號上存在串聯終端電阻器。靠近以太網 PHY 的接收時鐘和數據信號上存在串聯終端電阻器。

從 SoC 到 PHY 的 MDC 和 MDIO 信號需要將 4.7KΩ 上拉電阻器連接到 3.3V 系統電源電壓，才能正常工作。模擬開關 (TS5A23159DGSR) 負責在 CPSW MDIO/MDC 和 ICSSM MDIO/MDC 信號之間進行選擇并將其中一個信號路由至以太網 PHY。

AM263x 內部引腳多路復用用于在 CPSW RGMII 和 ICSSM 信號之間進行選擇。然后，信號會路由至 1:2 多路復用器 (TS3DDR3812RUAR)，當 BoosterPack 應用中使用 PRU GPIO 信號時，該器件負責選擇將信號映射到以太網 PHY 或者 BP 接頭。AM263x SoC GPIO 選擇信號可用于驅動 1:2 多路復用器。

表 4-4 以太網 PHY #2 CPSW/ICSSM 選擇

GPIO64	條件	多路復用器的功能
低電平	選擇了以太網 PHY	端口 A ? 端口 B
高電平	選擇了 BoosterPack 接頭	端口 A ? 端口 C

該以太網 PHY 的復位輸入由 WARMRESET AM263x SoC 輸出信號控制。

以太網 PHY 使用很多功能引腳用作 Strap 配置選項，以便將器件置于特定的運行模式。

表 4-5 以太網 PHY #2 配置 (strap) 電阻器

功能引腳	LP 中的模式	功能
RX_D0	0	PHY 地址：1100
RX_D1	3	PHY 地址：1100
JTAG_TDO/GPIO_1	0	RGMII 至銅線
RX_D3	0
RX_D2	0
LED_0	0	自動協商，廣播 1000/100/10，自動 MDI-X
RX_ER	0
LED_2	0
RX_DV	0	端口鏡像已禁用

注：每個配置 (strap) 引腳都具有一個 9KΩ 的內部下拉電阻

注： RX_D0 和 RX_D1 都采用 4 級配置 (strap) 電阻器模式方案。所有其他信號都采用 2 級配置 (strap) 電阻模式。