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ZHCSYW5 September 2025 TCAN843-Q1

ADVANCE INFORMATION

封裝選項

請參考 PDF 數(shù)據(jù)表獲取器件具體的封裝圖。

機械數(shù)據(jù) (封裝 | 引腳)

D|14
DYY|14
DMT|14

散熱焊盤機械數(shù)據(jù) (封裝 | 引腳)

訂購信息

zhcsyw5_oa

5.7 電氣特性

在建議工作條件下，T_J = –40°C 至 150°C（除非另外說明）。所有典型值均在 25°C、VSUP = 12V、VIO = 3.3V、VCC = 5V 且 RL = 60Ω 條件下獲得

參數(shù)			測試條件	最小值	典型值	最大值	單位
CAN 驅(qū)動器特性
V_CANH(D)	顯性輸出電壓總線偏置激活	CANH	TXD = 0V，50? ≤ R_L ≤ 65?，C_L = 開路，R_CM= 開路	2.75		4.5	V
V_CANH(D)	顯性輸出電壓總線偏置激活	CANL	TXD = 0V，50? ≤ R_L ≤ 65?，C_L = 開路，R_CM= 開路	0.5		2.25	V
V_CANH(R) V_CANL(R)	隱性輸出電壓總線偏置激活		TXD = V_IO，R_L = 開路（無負(fù)載），R_CM = 開路	2	2.5	3	V
V_SYM	驅(qū)動器對稱性總線偏置激活 (V_O(CANH) + V_O(CANL))/V_CC		EN = nSTB= V_IO，R_L = 60?，C_SPLIT = 4.7nF, C_L = 開路，R_CM = 開路，TXD = 250kHz、1MHz、2.5MHz	0.9		1.1	V/V
V_{SYM_DC}	直流驅(qū)動器對稱性總線偏置激活 V_CC – V_O(CANH) – V_O(CANL)		EN = nSTB= V_IO，R_L = 60?，C_L = 開路	-300		300	mV
V_DIFF(D)	差分輸出電壓總線偏置激活顯性	CANH - CANL	EN = nSTB =V_IO，TXD = 0V，50? ≤ R_L ≤ 65?，C_L = 開路	1.5		3	V
		CANH - CANL	EN = nSTB =V_IO，TXD = 0V，45? ≤ R_L ≤ 70?，CL = 開路	1.4		3.3	V
		CANH - CANL	EN = nSTB =V_IO，TXD = 0V，R_L = 2240?，C_L = 開路	1.5		5	V
V_DIFF(R)	差分輸出電壓總線偏置激活隱性	CANH - CANL	EN = nSTB =V_IO，TXD = V_IO，R_L = 開路，C_L = 開路	-50		50	mV
V_CANH(INACT)	總線輸出電壓總線偏置未激活	CANH	nSTB =0V，TXD = V_IO，R_L = 開路（無負(fù)載），C_L = 開路	-0.1		0.1	V
		CANL	nSTB =0V，TXD = V_IO，R_L = 開路（無負(fù)載），C_L = 開路	-0.1		0.1	V
		CANH - CANL	nSTB =0V，TXD = V_IO，R_L = 開路（無負(fù)載），C_L = 開路	-0.2		0.2	V
I_CANH(OS)	短路穩(wěn)態(tài)輸出電流總線偏置激活顯性		nSTB = V_IO，TXD = 0V –3V ≤ V_(CANH) ≤ 18V	-100			mA
I_CANH(OS)	短路穩(wěn)態(tài)輸出電流總線偏置激活顯性		nSTB = V_IO，TXD = 0V –3V ≤ V_(CANL) ≤ 18V			100	mA
I_{OS_REC}	短路穩(wěn)態(tài)輸出電流總線偏置激活隱性		nSTB = V_IO，V_BUS = CANH = CANL –27V ≤ V_BUS ≤ 40V	-3		3	mA
CAN 接收器特性
V_{DIFF_RX(D)}	接收器顯性狀態(tài)輸入電壓范圍總線偏置激活		nSTB = V_IO，–12V ≤ V_CM≤ 12V	0.9		8	V
V_{DIFF_RX(R)}	接收器隱性狀態(tài)輸入電壓范圍總線偏置激活		nSTB = V_IO，–12V ≤ V_CM≤ 12V	-3		0.5	V
V_HYS	輸入的遲滯電壓閾值總線偏置激活		nSTB = V_IO		80		mV
V_{DIFF_RX(D_INACT)}	接收器顯性狀態(tài)輸入電壓范圍總線偏置未激活		nSTB = 0V，–12V ≤ V_CM≤ 12V	1.1		9	V
V_{DIFF_RX(R_INACT)}	接收器隱性狀態(tài)輸入電壓范圍總線偏置未激活		nSTB = 0V，–12V ≤ V_CM≤ 12V	-4		0.4	V
V_CM	共模范圍		nSTB = V_IO	-12		12	V
I_LKG(IOFF)	斷電（未上電）輸入漏電流 CANH、CANL 引腳		V_SUP = 0V，CANH = CANL = 5V			5	μA
C_I	對地輸入電容（CANH 或 CANL）⁽¹⁾					20	pF
C_ID	差分輸入電容⁽¹⁾					10	pF
R_DIFF	差分輸入電阻		TXD = V_CC = V_IO = 5V，nSTB = 5V -2V ≤ V_CM ≤ 7V	50		100	k?
R_{SE_CANH} R_{SE_CANL}	輸入電阻（CANH 或 CANL）		TXD = V_CC = V_IO = 5V，nSTB = 5V -2V ≤ V_CM ≤ 7V	25		50	k?
m_R	輸入電阻匹配： [1 – R_IN(CANH) / R_IN(CANL)] × 100%		V_(CANH) = V_(CANL)= 5V	-2		2	%
TXD 特性
V_IH	高電平輸入電壓			0.7			V_IO
V_IL	低電平輸入電壓					0.3	V_IO
I_IH	高電平輸入漏電流		TXD = V_IO = 5.5V	-1	0	1	μA
I_IL	低電平輸入漏電流		TXD = 0V，V_IO = 5.5V	-115		-2.5	μA
I_LKG(OFF)	未供電時的漏電流		TXD = 5.5V，V_SUP = V_IO = 0V	-1	0	1	μA
C_I	輸入電容		V_IN = 0.4 x sin(2 × π × 2 × 10⁶ × t) + 2.5V		5	10	pF
RXD 特性
V_OH	高電平輸出電壓		I_O = -2mA	0.8			V_IO
V_OL	低電平輸出電壓		I_O = 2mA			0.2	V_IO
I_LKG(OFF)	未供電時的漏電流		RXD = 5.5V，V_SUP = V_IO = 0V	-1		1	μA
nSTB 特性
V_IH	高電平輸入電壓			0.7			V_IO
V_IL	低電平輸入電壓					0.3	V_IO
I_IH	高電平輸入漏電流		nSTB = V_IO = 5.5V	0.5		115	μA
I_IL	低電平輸入漏電流		nSTB = 0V，V_IO = 5.5V	-1		1	μA
I_LKG(OFF)	未供電時的漏電流		nSTB = 5.5V，V_IO = 0V	-1	0	1	μA
nFAULT 特性
V_OH	高電平輸出電壓		I_O = -2mA	0.8			V_IO
V_OL	低電平輸出電壓		I_O = 2mA			0.2	V_IO
I_LKG(OFF)	未供電時的漏電流		nFAULT = 5.5V，V_IO = 0V	-1	0	1	μA
EN 特性
V_IH	高電平輸入電壓			0.7			V_IO
V_IL	低電平輸入電壓					0.3	V_IO
I_IH	高電平輸入漏電流		EN = V_CC = V_IO = 5.5V	0.5		115	μA
I_IL	低電平輸入漏電流		EN = 0V，V_CC = V_IO = 5.5V	-1		1	μA
I_LKG(OFF)	未供電時的漏電流		EN = 5.5V，V_CC = V_IO = 0V	-1		1	μA
R_PD	下拉電阻			50		2000	k?
WAKE 特性
V_IH	高電平輸入電壓		睡眠模式	2.6			V
V_IL	低電平輸入電壓		睡眠模式			1.8	V
I_IH	高電平輸入漏電流⁽²⁾		WAKE = V_SUP			2	μA
I_IH	高電平輸入漏電流⁽²⁾		WAKE = 4V	-3			μA
I_IL	低電平輸入漏電流 ⁽²⁾		WAKE = 1V			3	μA
R_WAKE	上拉/下拉電阻⁽²⁾				600		kΩ
INH 特性
ΔV_H	從 VSUP 至 INH 的高電平壓降 (V_{SUP -}V_INH)		I_INH = –2mA		1	2	V
I_LKG(INH)	睡眠模式漏電流		INH = 0V	-0.5		0.5	μA

(1) 根據(jù)設(shè)計指定并通過工作臺表征來驗證

(2) 為了更大限度地降低系統(tǒng)級電流消耗，WAKE 引腳會根據(jù)施加的電壓自動配置為內(nèi)部上拉或下拉電流源。高電平輸入會產(chǎn)生內(nèi)部上拉電阻，低電平輸入會產(chǎn)生內(nèi)部下拉電阻。