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ZHCSWZ2A June 2024 – May 2025 LMX1860-SEP

PRODUCTION DATA

封裝選項

請參考 PDF 數據表獲取器件具體的封裝圖。

機械數據 (封裝 | 引腳)

PAP|64

散熱焊盤機械數據 (封裝 | 引腳)

訂購信息

5.5 電氣特性

2.4V ≤ V_CC ≤ 2.6V，–55°C ≤ T_C ≤ +125°C。典型值是 V_CC = 2.5V、25°C 條件下的值（除非另有說明）

參數		測試條件		最小值	典型值	最大值	單位
電流消耗
I_CC	電源電流 ⁽¹⁾	已上電，所有輸出和 SYSREF 均開啟			1050		mA
		已上電，所有輸出均開啟，所有 SYSREF 均關閉			600
		已上電，所有輸出和 SYSREF 均關閉			265
		已斷電⁽²⁾			11
SYSREF
f_SYSREF	SYSREF 輸出頻率	發生器模式				200	MHz
f_SYSREF	SYSREF 輸出頻率	中繼器模式				100	MHz
Δt	SYSREF 延遲步長	f_CLKIN = 12.8GHz			3		ps
t_RISE	上升時間（20% 至 80%）	SYSREFOUT			45		ps
		LOGISYSREFOUT	CML		120		ps
		LOGISYSREFOUT	LVDS		120		ps
t_FALL	下降時間（20% 至 80%）	SYSREFOUT			45		ps
		LOGISYSREFOUT	CML		120		ps
		LOGISYSREFOUT	LVDS		120		ps
V_OD	差分輸出電壓	SYSREFOUT			0.85		Vpp
		LOGISYSREFOUT	CML		0.4		Vp
		LOGISYSREFOUT	LVDS		0.4		Vp
V_SYSREFCM	共模電壓	SYSREFOUT	CML SYSREFOUTx_PWR = 4 100Ω 差分負載		0.8		V
SYSREFREQ 引腳
V_SYSREFIN	電壓輸入范圍	交流差分電壓		0.8		2	Vpp
V_CM	輸入共模	差分 100Ω 端接，直流耦合在外部設置		1.2	1.3	2	V
時鐘輸入
f_IN	輸入頻率	僅緩沖器模式		0.3		15⁽³⁾	GHz
P_IN	輸入功率	CLKIN_P 或 CLKIN_N 處的單端電源		0		10	dBm
時鐘輸出
f_OUT	輸出頻率	2 分頻		0.15		6.4	GHz
f_OUT	輸出頻率	緩沖器模式		0.3		15⁽³⁾
f_OUT	輸出頻率	x2、x3、x4		3.2		6.4
f_OUT	輸出頻率	LOGICLK 輸出		1		800	MHz
t_CAL	校準時間	倍頻器校準時間	f_IN = 3.2GHz；x2 f_SMCLK = 28MHz		750		μs
p_OUT	輸出功率	單端	f_CLKLOUT = 6GHz OUTx_PWR = 7		6		dBm
			f_CLKLOUT = 12.8GHz OUTx_PWR = 7		0
			f_CLKLOUT = 15GHz OUTx_PWR = 7		-3
t_RISE	上升時間（20% 至 80%）	f_CLKOUT= 300MHz			45		ps
t_FALL	下降時間（20% 至 80%）	f_CLKOUT= 300MHz			45		ps
t_MUTE	輸出靜音時間	OE 引腳的下降沿				30	μs
t_UNMUTE	輸出取消靜音時間	OE 引腳的上升沿				30	μs
傳播延遲和偏移
\| t_SKEW \|	輸出間的偏移幅度	T_A = -55°C 至 +125°C			2.5	10	ps
Δt_DLY/ΔT	傳播延遲隨溫度的變化	緩沖器模式		0.02	0.06	0.1	ps/C
t_DLY	傳播延遲	緩沖器模式	T_A = 25°C		180		ps
		分頻器模式			182
		倍頻器模式			185
噪聲、抖動和雜散
J_CKx	附加抖動	附加抖動。12kHz 至 100MHz 積分帶寬。	緩沖器模式		5		fs、rms
			x2 倍頻器		16
			x3 倍頻器		21
			x4 倍頻器		26
閃爍	1/f 閃爍噪聲	壓擺率 > 8V/ns，f_CLK=6GHz	緩沖器模式		-155		dBc/Hz
NFL	本底噪聲	f_OUT = 6GHz；f_Offset = 100MHz	緩沖器模式		-159		dBc/Hz
			2 分頻		-158.5
			倍頻器（x2、x3、x4）		-159.5
	本底噪聲	LOGICLK 輸出，300MHz	CML		-150.5		dBc/Hz
	本底噪聲	LOGICLK 輸出，300MHz	LVDS		-151.5		dBc/Hz
H2	二次諧波	f_OUT = 6GHz（差分），緩沖器模式			-25		dBc
		f_OUT = 6GHz（單端），緩沖器模式			-13
		f_OUT = 6GHz，單端，2 分頻			-16
H1/2	輸入時鐘泄漏雜散	f_OUT = 6GHz（單端）	x2 (f_SPUR= 3GHz)		-40		dBc
H1/3			x3 (f_SPUR= 2GHz)		-50		dBc
H1/4			x4 (f_SPUR= 1.5GHz)		-54		dBc
I_SPUR	LOGICLK 至 CLKOUT	f_SPUR = 300MHz（差分）			-70		dBc
數字接口（SCK、SDI、CS#、MUXOUT、CLKx_EN、MUXSELx、PWRSELx、DIVSELx、LOGIC_EN、SYSREF_EN、CAL、CE）
V_IH	高電平輸入電壓	SCK、SDI、CS#		1.4		3.3	V
V_IH	高電平輸入電壓	CLKX_EN、MUXSELx、PWRSELx、DIVSELx、LOGIC_EN、SYSREF_EN、CAL、CE		1.4		3.3	V
V_IL	低電平輸入電壓	SCK、SDI、CS#		0		0.4	V
V_IL	低電平輸入電壓	CLKX_EN、MUXSELx、PWRSELx、DIVSELx、LOGIC_EN、SYSREF_EN、CAL、CE		0		0.4	V
I_IH	高電平輸入電流	SCK、SDI、CS#		-42		42	μA
I_IH	高電平輸入電流	CLKX_EN、MUXSELx、PWRSELx、DIVSELx、LOGIC_EN、SYSREF_EN、CAL、CE		-42		42	μA
I_IL	低電平輸入電流	SCK、SDI、CS#		-25		25	μA
I_IL	低電平輸入電流	CLKX_EN、MUXSELx、PWRSELx、DIVSELx、LOGIC_EN、SYSREF_EN、CAL、CE		-25		25	μA
V_OH	高電平輸出電壓	MUXOUT	I_OH= 5mA	1.4		2.2	V
V_OH	高電平輸出電壓	MUXOUT	I_OH= 0.1mA	2.2		2.5	V
V_OL	低電平輸出電壓	MUXOUT	I_OL= 5mA			0.45	V

(1) 除非另有說明，否則 f_CLKIN=6GHz，CLK_MUX=緩沖器，所有時鐘均開啟且 OUTx_PWR=7、SYSREFREQ_MODE=1。

(2) 用于斷電模式。

(3) 支持 SYNC、分頻器、SYSREF 和 SYSREF 窗口化，頻率高達 12.8GHz。