SN74AUP1T08

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低功耗、1.8/2.5/3.3V 輸入、3.3V CMOS 輸出、2 輸入正與門

產品詳情

Technology family AUP1T Number of channels 1 Vout (min) (V) 2.3 Vout (max) (V) 3.6 Data rate (max) (Mbps) 200 IOH (max) (mA) -4 IOL (max) (mA) 4 Supply current (max) (μA) 0.9 Features Over-voltage tolerant inputs, Partial power down (Ioff), Single supply, Voltage translation Input type Schmitt-Trigger Output type Balanced CMOS, Push-Pull Operating temperature range (°C) -40 to 85
Technology family AUP1T Number of channels 1 Vout (min) (V) 2.3 Vout (max) (V) 3.6 Data rate (max) (Mbps) 200 IOH (max) (mA) -4 IOL (max) (mA) 4 Supply current (max) (μA) 0.9 Features Over-voltage tolerant inputs, Partial power down (Ioff), Single supply, Voltage translation Input type Schmitt-Trigger Output type Balanced CMOS, Push-Pull Operating temperature range (°C) -40 to 85
SOT-SC70 (DCK) 5 4.2 mm2 2 x 2.1
  • 靜電放電 (ESD) 性能測試符合 JESD 22 標準
    • 2000V 人體放電模型{1}（A114-B，II 類）
    • 1000V 充電器件模型 (C101)
  • 單電源電壓轉換器
  • 輸出電平高達電源 VCCCMOS 電平
    • 1.8V 至 3.3V（VCC=3.3V 時）
    • 2.5V 至 3.3V（VCC=3.3V 時）
    • 1.8V 至 2.5V（VCC=2.5V 時）
    • 3.3V 至 2.5V（VCC=2.5V 時）
  • 施密特觸發器輸入可抑制輸入噪聲并提供更佳的輸出信號完整性
  • I關閉支持部分斷電 (VCC=0)
  • 超低靜態功耗： 0.1μA
  • 超低動態功耗： 0.9μA
  • 閂鎖性能超過 100mA，符合 JESD 78 II 類規范的要求
  • 可提供無鉛封裝：SC70 (DCK) 2 x 2.1 x 0.65mm（高 1.1mm）
  • 有關更多邏輯門選項，請訪問 www.ti.com/littlelogic
  • 靜電放電 (ESD) 性能測試符合 JESD 22 標準
    • 2000V 人體放電模型{1}（A114-B，II 類）
    • 1000V 充電器件模型 (C101)
  • 單電源電壓轉換器
  • 輸出電平高達電源 VCCCMOS 電平
    • 1.8V 至 3.3V（VCC=3.3V 時）
    • 2.5V 至 3.3V（VCC=3.3V 時）
    • 1.8V 至 2.5V（VCC=2.5V 時）
    • 3.3V 至 2.5V（VCC=2.5V 時）
  • 施密特觸發器輸入可抑制輸入噪聲并提供更佳的輸出信號完整性
  • I關閉支持部分斷電 (VCC=0)
  • 超低靜態功耗： 0.1μA
  • 超低動態功耗： 0.9μA
  • 閂鎖性能超過 100mA，符合 JESD 78 II 類規范的要求
  • 可提供無鉛封裝：SC70 (DCK) 2 x 2.1 x 0.65mm（高 1.1mm）
  • 有關更多邏輯門選項，請訪問 www.ti.com/littlelogic

SN74AUP1T08 執行布爾函數 Y = A • B or Y = /A + /B，專門用于邏輯電平轉換應用，在此類應用中輸出以電源 VCC 為基準。

AUP 技術是行業最低功耗邏輯技術，此技術設計用于擴展運行中的電池壽命。所有接受 1.8V LVCMOS 信號的輸入電平，同時由一個單 3.3V 或 2.5V VCC電源供電運行。該產品還可以保持出色的信號完整性（請見Figure 5-1和Figure 5-2）。

2.3V 至 3.6V 的寬 VCC范圍有可能實現開關輸出電平連接至外部控制器或處理器。

施密特觸發器輸入（正負輸入轉換之間的 ΔVT=210mV）改進了開關轉換期間的抗擾度，這對于模擬混合模式設計十分有用。施密特觸發器輸入抑制輸入噪聲、確保輸出信號的完整性并可實現慢輸入信號轉換。

I關閉特性可實現省電條件 (VCC=0V) ，這在便攜式和移動應用中十分重要。當 VCC=0V 時，介于 0V 至 3.6V 范圍內的信號可被施加到器件的輸入和輸出上。在這些條件下，不會對器件造成損壞。

SN74AUP1T08 經設計優化具有 4mA 電流驅動能力，可減少由高驅動輸出導致的線路反射、過沖和下沖。

SN74AUP1T08 執行布爾函數 Y = A • B or Y = /A + /B，專門用于邏輯電平轉換應用，在此類應用中輸出以電源 VCC 為基準。

AUP 技術是行業最低功耗邏輯技術，此技術設計用于擴展運行中的電池壽命。所有接受 1.8V LVCMOS 信號的輸入電平，同時由一個單 3.3V 或 2.5V VCC電源供電運行。該產品還可以保持出色的信號完整性（請見Figure 5-1和Figure 5-2）。

2.3V 至 3.6V 的寬 VCC范圍有可能實現開關輸出電平連接至外部控制器或處理器。

施密特觸發器輸入（正負輸入轉換之間的 ΔVT=210mV）改進了開關轉換期間的抗擾度，這對于模擬混合模式設計十分有用。施密特觸發器輸入抑制輸入噪聲、確保輸出信號的完整性并可實現慢輸入信號轉換。

I關閉特性可實現省電條件 (VCC=0V) ，這在便攜式和移動應用中十分重要。當 VCC=0V 時，介于 0V 至 3.6V 范圍內的信號可被施加到器件的輸入和輸出上。在這些條件下，不會對器件造成損壞。

SN74AUP1T08 經設計優化具有 4mA 電流驅動能力，可減少由高驅動輸出導致的線路反射、過沖和下沖。
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評估板

5-8-LOGIC-EVM — 支持 5 至 8 引腳 DCK、DCT、DCU、DRL 和 DBV 封裝的通用邏輯評估模塊

靈活的 EVM 設計用于支持具有 5 至 8 引腳數且采用 DCK、DCT、DCU、DRL 或 DBV 封裝的任何器件。
用戶指南: PDF
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封裝 引腳 CAD 符號、封裝和 3D 模型
SOT-SC70 (DCK) 5 Ultra Librarian

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包含信息：
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  • REACH
  • 器件標識
  • 引腳鍍層/焊球材料
  • MSL 等級/回流焊峰值溫度
  • MTBF/時基故障估算
  • 材料成分
  • 鑒定摘要
  • 持續可靠性監測
包含信息：
  • 制造廠地點
  • 封裝廠地點

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