AFE7906
- 申請完整數(shù)據(jù)表
- 六個射頻采樣 14 位、3GSPS ADC
- 最大射頻信號帶寬:
- 4 個 ADC:每個 ADC 為 1200 MHz
- 6 個 ADC:每個 ADC 為 600 MHz
- 射頻頻率范圍:5MHz 至 12GHz
- 數(shù)字步進衰減器 (DSA):25dB 范圍,0.5dB 步長
- 單頻帶 DDC(在 6 個通道上)和雙頻帶 DDC(在 4 個通道上)
- 每個 DDC 通道 16 個 NCO
- 可選內(nèi)部 PLL/VCO,提供 ADC 采樣率下的 ADC 時鐘或外部時鐘
- Sysref 對齊檢測器
- 串行器/解串器數(shù)據(jù)接口:
- 可兼容 JESD204B 和 JESD204C
- 8 個高達 29.5Gbps 的串行器/解串器收發(fā)器
- 子類 1 多器件同步
- 封裝:17mm × 17mm FCBGA,間距為 0.8mm
AFE7906 是一款高性能、高帶寬、多通道接收器,集成了六個射頻采樣 ADC。此器件具有高達 12GHz 的工作頻率,支持直接在 L、S、C 和 X 帶頻率范圍內(nèi)進行射頻采樣,無需額外的頻率轉(zhuǎn)換級。密度和靈活性提高后可支持高通道數(shù)、多任務(wù)系統(tǒng)。
每個接收鏈均包含一個 25dB 范圍的 DSA(數(shù)字步進衰減器),后跟一個 3GSPS ADC(模數(shù)轉(zhuǎn)換器)。四個接收器通道都有模擬峰值功耗檢測器和各種數(shù)字功耗檢測器,可輔助進行外部或內(nèi)部自主自動增益控制器,另外還具有射頻過載檢測器,用于提供器件可靠性保護。靈活的抽取選項提供高達 1200MHz(對于四個 RX)或 600MHz 的數(shù)據(jù)帶寬優(yōu)化。
該器件包含一個 SYSREF 時序檢測器,用于優(yōu)化相對于器件時鐘的 SYSREF 輸入時序。
每個接收鏈均包含一個 25dB 范圍的 DSA(數(shù)字步進衰減器),后跟一個 3GSPS ADC(模數(shù)轉(zhuǎn)換器)。每個接收器通道都有一個模擬峰值功耗檢測器和各種數(shù)字功耗檢測器,可輔助外部或內(nèi)部自主的自動增益控制器,以及射頻過載檢測器,用于提供器件可靠性保護。靈活的抽取選項可優(yōu)化數(shù)據(jù)帶寬,在沒有 FB 路徑的情況下,為四個 RX 提供高達 1200MHz 帶寬;在采用兩條 FB 路徑(每條 1200MHz 帶寬)的情況下,整體優(yōu)化提供 600MHz 帶寬。
該器件包含一個 SYSREF 時序檢測器,用于優(yōu)化相對于器件時鐘的 SYSREF 輸入時序。
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技術(shù)文檔
| 類型 | 標題 | 下載最新的英語版本 | 日期 | |||
|---|---|---|---|---|---|---|
| * | 數(shù)據(jù)表 | 具有 3GSPS ADC 的 6 通道、5MHz 至 12GHz 的 AFE7906 射頻采樣接收器 數(shù)據(jù)表 (Rev. D) | PDF | HTML | 英語版 (Rev.D) | PDF | HTML | 2025年 6月 18日 |
| 用戶指南 | 使用 Xilinx FPGA 啟用 AFE79xx SPI 的指南 (Rev. A) | PDF | HTML | 英語版 (Rev.A) | PDF | HTML | 2024年 6月 19日 |
設(shè)計和開發(fā)
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| 封裝 | 引腳 | CAD 符號、封裝和 3D 模型 |
|---|---|---|
| FCBGA (ABJ) | 400 | Ultra Librarian |
| FCBGA (ALK) | 400 | Ultra Librarian |
訂購和質(zhì)量
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- 器件標識
- 引腳鍍層/焊球材料
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- 持續(xù)可靠性監(jiān)測
- 制造廠地點
- 封裝廠地點
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