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SN74AVC2T245-Q1

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Automotive 2-bit dual-supply bus transceiver with configurable voltage translation

產(chǎn)品詳情

Bits (#) 2 Data rate (max) (Mbps) 500 Topology Push-Pull Direction control (typ) Direction-controlled Vin (min) (V) 1.2 Vin (max) (V) 3.6 Vout (min) (V) 1.2 Vout (max) (V) 3.6 Applications GPIO Features Output enable, Partial power down (Ioff), Vcc isolation Technology family AVC Supply current (max) (mA) 0.016 Rating Automotive Operating temperature range (°C) -40 to 125
Bits (#) 2 Data rate (max) (Mbps) 500 Topology Push-Pull Direction control (typ) Direction-controlled Vin (min) (V) 1.2 Vin (max) (V) 3.6 Vout (min) (V) 1.2 Vout (max) (V) 3.6 Applications GPIO Features Output enable, Partial power down (Ioff), Vcc isolation Technology family AVC Supply current (max) (mA) 0.016 Rating Automotive Operating temperature range (°C) -40 to 125
UQFN (RSW) 10 2.52 mm2 1.8 x 1.4
  • 每個通道都具有獨立方向控制
  • 控制輸入電平 VIH/VIL 以 VCCA 電壓為基準
  • 完全可配置的雙軌設計，支持各個端口在 1.2V 至 3.6V 的整個電源電壓范圍內運行
  • I/O 可承受 4.6V 的電壓
  • Ioff 支持局部斷電模式運行
  • VCC 隔離特性 - 如果任何一個 VCC 輸入接地 (GND)，則兩個端口均處于高阻抗狀態(tài)
  • 典型數(shù)據(jù)速率
    • 500Mbps（1.8V 至 3.3V 電平轉換）
    • 320Mbps（<1.8V 至 3.3V 電平轉換）
    • 320Mbps（轉換至 2.5V 或 1.8V）
    • 280Mbps（轉換至 1.5V）
    • 240Mbps（轉換至 1.2V）
  • 閂鎖性能超過 100mA，符合 JESD 78 II 類規(guī)范的要求
  • ESD 保護性能超過 JESD 22 規(guī)范要求
    • 5000V 人體放電模型 (A114-A)
    • 200V 機器放電模型 (A115-A)
    • 1500V 充電器件模型 (C101)
  • 每個通道都具有獨立方向控制
  • 控制輸入電平 VIH/VIL 以 VCCA 電壓為基準
  • 完全可配置的雙軌設計，支持各個端口在 1.2V 至 3.6V 的整個電源電壓范圍內運行
  • I/O 可承受 4.6V 的電壓
  • Ioff 支持局部斷電模式運行
  • VCC 隔離特性 - 如果任何一個 VCC 輸入接地 (GND)，則兩個端口均處于高阻抗狀態(tài)
  • 典型數(shù)據(jù)速率
    • 500Mbps（1.8V 至 3.3V 電平轉換）
    • 320Mbps（<1.8V 至 3.3V 電平轉換）
    • 320Mbps（轉換至 2.5V 或 1.8V）
    • 280Mbps（轉換至 1.5V）
    • 240Mbps（轉換至 1.2V）
  • 閂鎖性能超過 100mA，符合 JESD 78 II 類規(guī)范的要求
  • ESD 保護性能超過 JESD 22 規(guī)范要求
    • 5000V 人體放電模型 (A114-A)
    • 200V 機器放電模型 (A115-A)
    • 1500V 充電器件模型 (C101)

這款 2 位同相總線收發(fā)器使用兩個獨立的可配置電源軌。A 端口旨在跟蹤 VCCA。VCCA 電源電壓為 1.2V 至 3.6V。B 端口旨在跟蹤 VCCB。VCCB 電源電壓為 1.2V 至 3.6V。因此可在 1.2V、1.5V、1.8V、2.5V 和 3.3V 電壓節(jié)點之間進行通用的低電壓雙向轉換。

SN74AVC2T245-Q1 旨在實現(xiàn)兩條數(shù)據(jù)總線間的異步通信。方向控制 (DIR) 輸入和輸出使能 (OE) 的邏輯電平激活 B 端口輸出或者 A 端口輸出，或者將兩個輸出端口都置于高阻抗模式。當 B 端口輸出被激活時，此器件將數(shù)據(jù)從 A 總線發(fā)送到 B 總線，而當 A 端口輸出被激活時，此器件將數(shù)據(jù)從 B 總線發(fā)送到 A 總線。A 端口和 B 端口上的輸入電路一直處于激活狀態(tài)并且必須施加一個邏輯高或低電平，從而防止過大的 ICC 和 ICCZ。

SN74AVC2T245-Q1 的控制引腳（DIR1、DIR2 和 OE）由 VCCA 供電。

該器件專用于使用 Ioff 的局部斷電應用。Ioff 電路可禁用輸出，以防在器件斷電時電流回流對器件造成損壞。

VCC 隔離特性可確保只要有任何一個 VCC 輸入接地 (GND)，則兩個端口均處于高阻抗狀態(tài)。

為了確保上電或下電期間的高阻抗狀態(tài)，OE 必須通過一個上拉電阻器連接至 VCC；該電阻器的最小阻值由驅動器的電流灌入能力來決定。

這款 2 位同相總線收發(fā)器使用兩個獨立的可配置電源軌。A 端口旨在跟蹤 VCCA。VCCA 電源電壓為 1.2V 至 3.6V。B 端口旨在跟蹤 VCCB。VCCB 電源電壓為 1.2V 至 3.6V。因此可在 1.2V、1.5V、1.8V、2.5V 和 3.3V 電壓節(jié)點之間進行通用的低電壓雙向轉換。

SN74AVC2T245-Q1 旨在實現(xiàn)兩條數(shù)據(jù)總線間的異步通信。方向控制 (DIR) 輸入和輸出使能 (OE) 的邏輯電平激活 B 端口輸出或者 A 端口輸出，或者將兩個輸出端口都置于高阻抗模式。當 B 端口輸出被激活時，此器件將數(shù)據(jù)從 A 總線發(fā)送到 B 總線，而當 A 端口輸出被激活時，此器件將數(shù)據(jù)從 B 總線發(fā)送到 A 總線。A 端口和 B 端口上的輸入電路一直處于激活狀態(tài)并且必須施加一個邏輯高或低電平，從而防止過大的 ICC 和 ICCZ。

SN74AVC2T245-Q1 的控制引腳（DIR1、DIR2 和 OE）由 VCCA 供電。

該器件專用于使用 Ioff 的局部斷電應用。Ioff 電路可禁用輸出，以防在器件斷電時電流回流對器件造成損壞。

VCC 隔離特性可確保只要有任何一個 VCC 輸入接地 (GND)，則兩個端口均處于高阻抗狀態(tài)。

為了確保上電或下電期間的高阻抗狀態(tài)，OE 必須通過一個上拉電阻器連接至 VCC；該電阻器的最小阻值由驅動器的電流灌入能力來決定。
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* 數(shù)據(jù)表 具有可配置電平轉換/電壓轉換和三態(tài)輸出的 SN74AVC2T245-Q1 2 位雙電源總線收發(fā)器 數(shù)據(jù)表 PDF | HTML 英語版 PDF | HTML 2025年 11月 25日
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應用手冊 Understanding and Interpreting Standard-Logic Data Sheets (Rev. C) 2015年 12月 2日
應用手冊 Voltage Translation Between 3.3-V, 2.5-V, 1.8-V, and 1.5-V Logic Standards (Rev. B) 2015年 4月 30日
選擇指南 邏輯器件指南 2014 (Rev. AA) 最新英語版本 (Rev.AC) PDF | HTML 2014年 11月 17日
用戶指南 LOGIC Pocket Data Book (Rev. B) 2007年 1月 16日
應用手冊 選擇正確的電平轉換解決方案 (Rev. A) 英語版 (Rev.A) 2006年 3月 23日
應用手冊 Semiconductor Packing Material Electrostatic Discharge (ESD) Protection 2004年 7月 8日
更多文獻資料 LCD Module Interface Application Clip 2003年 5月 9日
用戶指南 AVC Advanced Very-Low-Voltage CMOS Logic Data Book, March 2000 (Rev. C) 2002年 8月 20日
更多文獻資料 Standard Linear & Logic for PCs, Servers & Motherboards 2002年 6月 13日
應用手冊 16-Bit Widebus Logic Families in 56-Ball, 0.65-mm Pitch Very Thin Fine-Pitch BGA (Rev. B) 2002年 5月 22日
應用手冊 Dynamic Output Control (DOC) Circuitry Technology And Applications (Rev. B) 1999年 7月 7日
應用手冊 AVC Logic Family Technology and Applications (Rev. A) 1998年 8月 26日

設計和開發(fā)

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評估板

5-8-NL-LOGIC-EVM — 支持 5 至 8 引腳 DPW、DQE、DRY、DSF、DTM、DTQ 和 DTT 封裝的通用邏輯和轉換 EVM

通用 EVM 旨在支持采用 DTT、DRY、DPW、DTM、DQE、DQM、DSF 或 DTQ 封裝的任何邏輯或轉換器件。電路板設計可實現(xiàn)靈活的評估。

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