產品詳情

Technology family AHC Supply voltage (min) (V) 2 Supply voltage (max) (V) 5.5 Number of channels 4 Inputs per channel 2 IOL (max) (mA) 8 IOH (max) (mA) -8 Input type Standard CMOS Output type Push-Pull Features Over-voltage tolerant inputs, Very high speed (tpd 5-10ns) Data rate (max) (Mbps) 110 Rating Catalog Operating temperature range (°C) -40 to 125
Technology family AHC Supply voltage (min) (V) 2 Supply voltage (max) (V) 5.5 Number of channels 4 Inputs per channel 2 IOL (max) (mA) 8 IOH (max) (mA) -8 Input type Standard CMOS Output type Push-Pull Features Over-voltage tolerant inputs, Very high speed (tpd 5-10ns) Data rate (max) (Mbps) 110 Rating Catalog Operating temperature range (°C) -40 to 125
PDIP (N) 14 181.42 mm2 19.3 x 9.4 SOIC (D) 14 51.9 mm2 8.65 x 6 SOP (NS) 14 79.56 mm2 10.2 x 7.8 SSOP (DB) 14 48.36 mm2 6.2 x 7.8 TSSOP (PW) 14 32 mm2 5 x 6.4 TVSOP (DGV) 14 23.04 mm2 3.6 x 6.4 VQFN (RGY) 14 12.25 mm2 3.5 x 3.5 WQFN (BQA) 14 7.5 mm2 3 x 2.5
  • 工作電壓范圍為 2V 至 5.5V
  • 閂鎖性能超過 250mA，符合 JESD 17 規范
  • 工作電壓范圍為 2V 至 5.5V
  • 閂鎖性能超過 250mA，符合 JESD 17 規范

’AHC00 器件以正邏輯執行布爾函數 Y = A • B 或 Y = A + B。

’AHC00 器件以正邏輯執行布爾函數 Y = A • B 或 Y = A + B。
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產品概述 Military Advanced High-Speed CMOS Logic (AHC/AHCT) (Rev. C) 1998年 4月 1日
應用手冊 Migration From 3.3-V To 2.5-V Power Supplies For Logic Devices 1997年 12月 1日
應用手冊 Bus-Interface Devices With Output-Damping Resistors Or Reduced-Drive Outputs (Rev. A) 1997年 8月 1日
應用手冊 CMOS Power Consumption and CPD Calculation (Rev. B) 1997年 6月 1日
應用手冊 Live Insertion 1996年 10月 1日
選擇指南 Logic Guide (Rev. AC) PDF | HTML 1994年 6月 1日

設計和開發

如需其他信息或資源，請點擊以下任一標題進入詳情頁面查看（如有）。

評估板

14-24-LOGIC-EVM — 采用 14 引腳至 24 引腳 D、DB、DGV、DW、DYY、NS 和 PW 封裝的邏輯產品通用評估模塊

14-24-LOGIC-EVM 評估模塊 (EVM) 設計用于支持采用 14 引腳至 24 引腳 D、DW、DB、NS、PW、DYY 或 DGV 封裝的任何邏輯器件。

用戶指南: PDF | HTML
英語版 (Rev.B): PDF | HTML
TI.com 上無現貨
評估板

14-24-NL-LOGIC-EVM — 采用 14 引腳至 24 引腳無引線封裝的邏輯產品通用評估模塊

14-24-EVM 是一款靈活的評估模塊 (EVM)，旨在支持具有 14 引腳至 24 引腳 BQA、BQB、RGY、RSV、RJW 或 RHL 封裝的任何邏輯或轉換器件。

用戶指南: PDF | HTML
英語版 (Rev.A): PDF | HTML
TI.com 上無現貨
仿真模型

HSPICE Model of SN74AHC00 (Rev. A)

SCLJ008A.ZIP (98 KB) - HSpice Model
下載
仿真模型

SN74AHC00 Behavioral SPICE Model

SCLM287.ZIP (7 KB) - PSpice Model
下載
仿真模型

SN74AHC00 IBIS Model

SCEM516.ZIP (35 KB) - IBIS Model
下載
參考設計

TIDEP0036 — 采用 TMS320C6657 實現的高效 OPUS 編解碼器解決方案參考設計

TIDEP0036 參考設計演示了如何在 TMS320C6657 器件上輕松運行經 TI 優化的 Opus 編碼器/解碼器。由于 Opus 支持各類比特率、幀大小和采樣率且均延遲極低，因而適用于語音通信、聯網音頻甚至高性能音頻處理應用。較之 ARM 等通用處理器，此設計還通過在 DSP 上實現 Opus 編解碼器來提升性能。根據通用處理器上所運行代碼的優化級別，通過在 C66x TI DSP 核心上實現 Opus 編解碼器即可提供 3 倍于 ARM CORTEX A-15 方案的性能。
設計指南: PDF
原理圖: PDF
封裝 引腳 CAD 符號、封裝和 3D 模型
PDIP (N) 14 Ultra Librarian
SOIC (D) 14 Ultra Librarian
SOP (NS) 14 Ultra Librarian
SSOP (DB) 14 Ultra Librarian
TSSOP (PW) 14 Ultra Librarian
TVSOP (DGV) 14 Ultra Librarian
VQFN (RGY) 14 Ultra Librarian
WQFN (BQA) 14 Ultra Librarian

訂購和質量

包含信息：
  • RoHS
  • REACH
  • 器件標識
  • 引腳鍍層/焊球材料
  • MSL 等級/回流焊峰值溫度
  • MTBF/時基故障估算
  • 材料成分
  • 鑒定摘要
  • 持續可靠性監測
包含信息：
  • 制造廠地點
  • 封裝廠地點

支持和培訓

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