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LP2995

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DDR 終端穩(wěn)壓器

產(chǎn)品詳情

Product type DDR Vin (min) (V) 2.2 Vin (max) (V) 5.5 Vout (min) (V) 1.21 Vout (max) (V) 1.26 Features No external resistors Rating Catalog Operating temperature range (°C) 0 to 125 Iq (typ) (mA) 0.25 DDR memory type DDR
Product type DDR Vin (min) (V) 2.2 Vin (max) (V) 5.5 Vout (min) (V) 1.21 Vout (max) (V) 1.26 Features No external resistors Rating Catalog Operating temperature range (°C) 0 to 125 Iq (typ) (mA) 0.25 DDR memory type DDR
HSOIC (DDA) 8 29.4 mm2 4.9 x 6 SOIC (D) 8 29.4 mm2 4.9 x 6 WQFN (NHP) 16 16 mm2 4 x 4
  • Low Output Voltage Offset
  • Works with +5v, +3.3v and 2.5v Rails
  • Source and Sink Current
  • Low External Component Count
  • No External Resistors Required
  • Linear Topology
  • Available in SOIC-8, SO PowerPAD-8 or WQFN-16 Packages
  • Low Cost and Easy to Use

All trademarks are the property of their respective owners.

  • Low Output Voltage Offset
  • Works with +5v, +3.3v and 2.5v Rails
  • Source and Sink Current
  • Low External Component Count
  • No External Resistors Required
  • Linear Topology
  • Available in SOIC-8, SO PowerPAD-8 or WQFN-16 Packages
  • Low Cost and Easy to Use

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The LP2995 linear regulator is designed to meet the JEDEC SSTL-2 and SSTL-3 specifications for termination of DDR-SDRAM. The device contains a high-speed operational amplifier to provide excellent response to load transients. The output stage prevents shoot through while delivering 1.5A continuous current and transient peaks up to 3A in the application as required for DDR-SDRAM termination. The LP2995 also incorporates a VSENSE pin to provide superior load regulation and a VREF output as a reference for the chipset and DDR DIMMS.

The LP2995 linear regulator is designed to meet the JEDEC SSTL-2 and SSTL-3 specifications for termination of DDR-SDRAM. The device contains a high-speed operational amplifier to provide excellent response to load transients. The output stage prevents shoot through while delivering 1.5A continuous current and transient peaks up to 3A in the application as required for DDR-SDRAM termination. The LP2995 also incorporates a VSENSE pin to provide superior load regulation and a VREF output as a reference for the chipset and DDR DIMMS.
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技術(shù)文檔

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類型 標(biāo)題 下載最新的英語版本 日期
* 數(shù)據(jù)表 LP2995 DDR Termination Regulator 數(shù)據(jù)表 (Rev. M) 2013年 3月 19日
應(yīng)用手冊 Limiting DDR Termination Regulators’ Inrush Current 2016年 8月 23日
EVM 用戶指南 AN-1241 LP2995 Evaluation Board (Rev. B) 2013年 5月 7日
應(yīng)用手冊 AN-1254 DDR-SDRAM Termination Simplified Using a Linear Regulator (Rev. A) 2013年 5月 6日
應(yīng)用手冊 DDR-SDRAM Termination Simplified Using A Linear Regulator 2002年 7月 23日

設(shè)計和開發(fā)

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仿真模型

LP2995 PSpice Transient Model

SNVMAH6.ZIP (71 KB) - PSpice Model
下載
仿真模型

LP2995 Unencrypted PSpice Transient Model

SNVMAH5.ZIP (4 KB) - PSpice Model
下載
參考設(shè)計

TIDA-010011 — 適用于保護(hù)繼電器處理器模塊的高效電源架構(gòu)參考設(shè)計

該參考設(shè)計展示了各種電源架構(gòu)，這些架構(gòu)可為需要 >1A 負(fù)載電流和高效率的應(yīng)用處理器模塊生成多個電壓軌。所需的電源通過來自背板的 5V、12V 或 24V 直流輸入生成。電源通過帶集成 FET 的直流/直流轉(zhuǎn)換器生成并且使用帶集成電感器的電源模塊以減小尺寸。此設(shè)計采用 HotRod? 封裝類型，適用于需要低 EMI 的應(yīng)用，也非常適合設(shè)計時間受限的應(yīng)用。其他功能包括 DDR 端接穩(wěn)壓器、輸入電源 OR-ing、電壓時序控制、過載保護(hù)電子保險絲以及電壓和負(fù)載電流監(jiān)控。該設(shè)計可以用于處理器、數(shù)字信號處理器和現(xiàn)場可編程門陣列。該設(shè)計已依照 CISPR22 標(biāo)準(zhǔn)針對輻射發(fā)射進(jìn)行了測試，符合 A (...)
原理圖: PDF
封裝 引腳 CAD 符號、封裝和 3D 模型
HSOIC (DDA) 8 Ultra Librarian
SOIC (D) 8 Ultra Librarian
WQFN (NHP) 16 Ultra Librarian

訂購和質(zhì)量

包含信息：
  • RoHS
  • REACH
  • 器件標(biāo)識
  • 引腳鍍層/焊球材料
  • MSL 等級/回流焊峰值溫度
  • MTBF/時基故障估算
  • 材料成分
  • 鑒定摘要
  • 持續(xù)可靠性監(jiān)測
包含信息：
  • 制造廠地點
  • 封裝廠地點

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