產品詳情

Function Single-ended Additive RMS jitter (typ) (fs) 45 Output frequency (max) (MHz) 200 Number of outputs 10 Output supply voltage (V) 2.5, 3.3 Core supply voltage (V) 2.5, 3.3 Output skew (ps) 100 Features Pin control Operating temperature range (°C) -55 to 125 Rating HiRel Enhanced Product Output type LVTTL Input type LVTTL
Function Single-ended Additive RMS jitter (typ) (fs) 45 Output frequency (max) (MHz) 200 Number of outputs 10 Output supply voltage (V) 2.5, 3.3 Core supply voltage (V) 2.5, 3.3 Output skew (ps) 100 Features Pin control Operating temperature range (°C) -55 to 125 Rating HiRel Enhanced Product Output type LVTTL Input type LVTTL
TSSOP (PW) 24 49.92 mm2 7.8 x 6.4
  • 高性能 1:10 時鐘驅動器
  • 在 VDD為 3.3V 時，運行頻率高達 200MHz
  • 在 VDD為 3.3V 時，引腳到引腳偏斜小于 100ps
  • VDD范圍：2.3V 至 3.6V
  • 輸出使能毛刺脈沖抑制
  • 將一個時鐘輸入分頻至五個輸出的兩個組
  • 25? 片載串聯阻尼電阻器
  • 采用 24 引腳薄型小尺寸封裝 (TSSOP)
  • 高性能 1:10 時鐘驅動器
  • 在 VDD為 3.3V 時，運行頻率高達 200MHz
  • 在 VDD為 3.3V 時，引腳到引腳偏斜小于 100ps
  • VDD范圍：2.3V 至 3.6V
  • 輸出使能毛刺脈沖抑制
  • 將一個時鐘輸入分頻至五個輸出的兩個組
  • 25? 片載串聯阻尼電阻器
  • 采用 24 引腳薄型小尺寸封裝 (TSSOP)

CDCVF2310 是一款運行頻率高達 200MHz 的高性能、低偏斜時鐘緩沖器。 五個輸出的兩個組中的每一個組提供 CLK 的低偏斜副本。 加電后，無論控制引腳的狀態如何，輸出的缺省狀態為低電平。 對于正常運行，當控制引腳（分別為 1G 或 2G）被保持在低電平并且在 CLK 輸入上檢測到一個負時鐘邊沿時，組 1Y[0:4] 或 2Y[0:4] 的輸出可被置于低電平狀態。 當控制引腳（1G 和 2G）被保持在高電平并且在 CLK 輸入上檢測到一個負時鐘邊沿時，組 1Y[0:4] 或 2Y[0:4] 的輸出可被切換至緩沖器模式。 此器件運行在一個
2.5V 和 3.3V 環境中。 內置的輸出使能毛刺脈沖抑制可確保一個已同步的輸出使能序列以分配完全周期時鐘信號。

CDCVF2310 運行溫度范圍為 -55°C 至 125°C。

CDCVF2310 是一款運行頻率高達 200MHz 的高性能、低偏斜時鐘緩沖器。 五個輸出的兩個組中的每一個組提供 CLK 的低偏斜副本。 加電后，無論控制引腳的狀態如何，輸出的缺省狀態為低電平。 對于正常運行，當控制引腳（分別為 1G 或 2G）被保持在低電平并且在 CLK 輸入上檢測到一個負時鐘邊沿時，組 1Y[0:4] 或 2Y[0:4] 的輸出可被置于低電平狀態。 當控制引腳（1G 和 2G）被保持在高電平并且在 CLK 輸入上檢測到一個負時鐘邊沿時，組 1Y[0:4] 或 2Y[0:4] 的輸出可被切換至緩沖器模式。 此器件運行在一個
2.5V 和 3.3V 環境中。 內置的輸出使能毛刺脈沖抑制可確保一個已同步的輸出使能序列以分配完全周期時鐘信號。

CDCVF2310 運行溫度范圍為 -55°C 至 125°C。
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* 數據表 2.5V 至3.3V 高性能時鐘緩沖器 數據表 英語版 PDF | HTML 2013年 1月 21日
* VID CDCVF2310-EP VID V6213603 2016年 6月 21日
* 輻射與可靠性報告 CDCVF2310MPWEP Relability Report 2016年 2月 9日
* 輻射與可靠性報告 CDCVF2310MPWREP Reliability Report 2016年 2月 9日

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設計工具

CLOCK-TREE-ARCHITECT — 時鐘樹架構編程軟件

時鐘樹架構是一款時鐘樹綜合工具，可根據您的系統要求生成時鐘樹解決方案，從而幫助您簡化設計流程。該工具從龐大的時鐘產品數據庫中提取數據，然后生成系統級多芯片時鐘解決方案。
立即設計
模擬工具

PSPICE-FOR-TI — PSpice? for TI 設計和仿真工具

PSpice? for TI 可提供幫助評估模擬電路功能的設計和仿真環境。此功能齊全的設計和仿真套件使用 Cadence? 的模擬分析引擎。PSpice for TI 可免費使用，包括業內超大的模型庫之一，涵蓋我們的模擬和電源產品系列以及精選的模擬行為模型。

借助?PSpice for TI 的設計和仿真環境及其內置的模型庫，您可對復雜的混合信號設計進行仿真。創建完整的終端設備設計和原型解決方案，然后再進行布局和制造，可縮短產品上市時間并降低開發成本。?

在?PSpice for TI 設計和仿真工具中，您可以搜索 TI (...)
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TSSOP (PW) 24 Ultra Librarian

訂購和質量

包含信息：
  • RoHS
  • REACH
  • 器件標識
  • 引腳鍍層/焊球材料
  • MSL 等級/回流焊峰值溫度
  • MTBF/時基故障估算
  • 材料成分
  • 鑒定摘要
  • 持續可靠性監測
包含信息：
  • 制造廠地點
  • 封裝廠地點

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