CD74ACT273

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具有復位功能的八路 D 類觸發器

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Number of channels 8 Technology family ACT Supply voltage (min) (V) 4.5 Supply voltage (max) (V) 5.5 Input type TTL-Compatible CMOS Output type Push-Pull Clock frequency (max) (MHz) 97 IOL (max) (mA) 24 IOH (max) (mA) -24 Supply current (max) (μA) 80 Features Balanced outputs, Positive input clamp diode, Very high speed (tpd 5-10ns) Operating temperature range (°C) -55 to 125 Rating Catalog
Number of channels 8 Technology family ACT Supply voltage (min) (V) 4.5 Supply voltage (max) (V) 5.5 Input type TTL-Compatible CMOS Output type Push-Pull Clock frequency (max) (MHz) 97 IOL (max) (mA) 24 IOH (max) (mA) -24 Supply current (max) (μA) 80 Features Balanced outputs, Positive input clamp diode, Very high speed (tpd 5-10ns) Operating temperature range (°C) -55 to 125 Rating Catalog
PDIP (N) 20 228.702 mm2 24.33 x 9.4 SOIC (DW) 20 131.84 mm2 12.8 x 10.3 SSOP (DB) 20 56.16 mm2 7.2 x 7.8 TSSOP (PW) 20 41.6 mm2 6.5 x 6.4
  • 緩沖輸入
  • 典型傳播延遲
    • VCC = 5V、TA = 25°C 且 CL = 50pF 時為 6.5ns
  • 防 SCR 閂鎖 CMOS 工藝和電路設計
  • 具有雙極 FAST?/AS/S 的速度,同時功耗顯著降低
  • 平衡傳播延遲
  • 交流類型的工作電壓范圍為 1.5V 至 5.5V,并在電源電壓的 30% 時具有平衡的抗噪性能
  • ±24mA 輸出驅動電流
    • 扇出到 15 個 FAST? IC
    • 驅動 50Ω 傳輸線
  • 緩沖輸入
  • 典型傳播延遲
    • VCC = 5V、TA = 25°C 且 CL = 50pF 時為 6.5ns
  • 防 SCR 閂鎖 CMOS 工藝和電路設計
  • 具有雙極 FAST?/AS/S 的速度,同時功耗顯著降低
  • 平衡傳播延遲
  • 交流類型的工作電壓范圍為 1.5V 至 5.5V,并在電源電壓的 30% 時具有平衡的抗噪性能
  • ±24mA 輸出驅動電流
    • 扇出到 15 個 FAST? IC
    • 驅動 50Ω 傳輸線

’AC273 和 ’ACT273 器件是采用高級 CMOS 邏輯技術、具有復位功能的八通道 D 型觸發器。D 輸入端的信息在時鐘脈沖的上升沿傳輸到 Q 輸出端。所有八個觸發器均由通用時鐘 (CP) 和通用復位 (MR) 控制。復位通過低電壓電平完成,與時鐘無關。

’AC273 和 ’ACT273 器件是采用高級 CMOS 邏輯技術、具有復位功能的八通道 D 型觸發器。D 輸入端的信息在時鐘脈沖的上升沿傳輸到 Q 輸出端。所有八個觸發器均由通用時鐘 (CP) 和通用復位 (MR) 控制。復位通過低電壓電平完成,與時鐘無關。

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應用手冊 CMOS Power Consumption and CPD Calculation (Rev. B) 1997年 6月 1日
應用手冊 使用邏輯器件進行設計 (Rev. C) 1997年 6月 1日
應用手冊 Using High Speed CMOS and Advanced CMOS in Systems With Multiple Vcc 1996年 4月 1日
選擇指南 Logic Guide (Rev. AC) PDF | HTML 1994年 6月 1日

設計和開發

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評估板

14-24-LOGIC-EVM — 采用 14 引腳至 24 引腳 D、DB、DGV、DW、DYY、NS 和 PW 封裝的邏輯產品通用評估模塊

14-24-LOGIC-EVM 評估模塊 (EVM) 設計用于支持采用 14 引腳至 24 引腳 D、DW、DB、NS、PW、DYY 或 DGV 封裝的任何邏輯器件。

用戶指南: PDF | HTML
英語版 (Rev.B): PDF | HTML
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封裝 引腳 CAD 符號、封裝和 3D 模型
PDIP (N) 20 Ultra Librarian
SOIC (DW) 20 Ultra Librarian
SSOP (DB) 20 Ultra Librarian
TSSOP (PW) 20 Ultra Librarian

訂購和質量

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  • MTBF/時基故障估算
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  • 鑒定摘要
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包含信息:
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